- •Общие сведения о эвм
- •Этапы развития эвм
- •1.2 Характеристики эвм
- •1.3 Классификация средств эвт
- •1.4 Структуры эвм
- •1.4.1 Обобщенная структура эвм
- •1.4.2 Структура эвм на основе общей шины
- •Структура эвм на основе множества шин
- •1.5 Контрольные вопросы
- •Архитектура классической эвм
- •Принцип программного управления
- •Принцип хранимой в памяти программы
- •Обобщенный формат команд
- •Способы адресации команд
- •Процессоры с принудительным порядком выполнения команд
- •Процессоры с естественной адресацией команд Упрощенная структура процессора с естественной адресацией команд приведена на рисунке 2.2.
- •2.5 Способы адресации операндов
- •Прямая адресация
- •2.5.2 Регистровая адресация
- •Косвенная адресация
- •Непосредственная адресация
- •Неявная адресация
- •Относительная (базовая) адресация
- •Индексная (автоинкрементная или автодекрементная) адресация
- •2.6 Контрольные вопросы
- •3. Запоминающие устройства эвм
- •3.1 Основные понятия
- •Классификация зу
- •3.3 Озу с произвольным доступом
- •3.4 Организация микросхем sram
- •3.5 Организация динамической памяти
- •3.6 Особенности микросхем синхронной динамической памяти
- •Основные характеристики зу
- •3.8 Озу магазинного типа (стековая память)
- •Ассоциативные зу
- •3.10 Контрольные вопросы
- •4.1 Обобщенные структуры процессоров с непосредственными и магистральными связями
- •4.2 Декомпозиция процессора на уа и оу
- •4.3 Арифметико- логические устройства
- •4.3.1 Классификация арифметико-логических устройств
- •4.3.2 Алу для сложения и вычитания чисел с фиксированной запятой
- •4.3.3 Алу для умножения двоичных чисел
- •4.3.4 Методы ускорения умножения
- •4.3.5 Особенности операций десятичной арифметики
- •4.3.6 Операции над числами с плавающей запятой
- •4.4 Устройства управления
- •4.4.1 Классификация уу
- •4.4.2 Аппаратные уу
- •4.4.3 Микропрограммные уу
- •4.5. Структурно - функциональная организация классического процессора
- •4.6 Рабочий цикл процессора
- •4.7 Понятие о слове состояния процессора
- •4.8 Процедура выполнения команд перехода (условного и безусловного)
- •4.9 Процедура выполнения команд вызова подпрограмм
- •4.10 Контрольные вопросы
- •Системы прерывания программ
- •5.1 Общие сведения
- •5.2 Характеристики систем прерываний
- •5.3 Схема выполнения процедуры прерывания
- •5.4 Способы реализации систем прерываний
- •5.4.1 Схема прерывания с опросом по вектору
- •5.4.2 Прерывания с программно - управляемым приоритетом
- •5.5 Контрольные вопросы
- •6. Организация ввода-вывода
- •6.1 Общие сведения о вводе-выводе в эвм
- •6.2 Основные способы ввода-вывода
- •6.2.1 Программно - управляемый ввод - вывод
- •6.2.2 Ввод - вывод с прерыванием программы
- •6.2.3 Ввод - вывод в режиме пдп
- •6.3 Интерфейсы
- •6.3.1 Характеристики интерфейсов
- •6.3.2 Шины интерфейсов ввода-вывода
- •6.3.2.1 Синхронные шины
- •6.3.2.2 Асинхронные шины
- •6.4 Контрольные вопросы
- •7. Организация памяти эвм с магистральной архитектурой
- •7.1 Организация адресного пространства памяти и ввода-вывода. Изолированная и совмещенная адресные пространства
- •7.1.1 Изолированное адресное пространство памяти и ввода- вывода
- •7.1.2. Совмещенное адресное пространство памяти и ввода- вывода
- •7.2 Организация пзу. Проектирование памяти эвм
- •7.3 Построение оперативной памяти на микросхемах статического типа
- •7.4 Построение оперативной памяти на микросхемах dram
- •7.5 Память с чередованием адресов
- •7.6 Регенерация динамической памяти
- •Кэш прямого отображения
- •7.7.2 Наборно- ассоциативный кэш
- •Контрольные вопросы
- •8 Организация пк
- •8.1 Структурная схема системной платы эвм ibm pc/at 286
- •8.1.1 Система шин системной платы эвм ibm pc/at 286
- •8.1.2 Состав и назначение основных устройств системной платы эвм ibm pc/at 286
- •8.1.2.1 Назначение и характеристики процессора и сопроцессора
- •8.1.2.2 Назначение и характеристики генераторов тактовых сигналов
- •8.1.2.3 Назначение шинных формирователей
- •8.1.2.4 Формирование управляющих сигналов и работа подсистемы памяти
- •8.1.2.5 Назначение и характеристики периферийных устройств системной платы
- •8.1.2.6 Назначение пзу bios
- •8.1.3 Шина isa
- •8.1.3.1 Особенности шины isa
- •8.1.3.2 Основные сигналы шины isa
- •8.1.3.3 Шинные циклы магистрали isa
- •8.1.3.4 Электрические и конструктивные характеристики шины isa
- •8.1.3.5 Конвейеризация шины
- •8.2 Структурная схема системной платы эвм ibm pc/at Pentium
- •8.2.1 Локальные шины ввода -вывода
- •8.2.2 Состав и назначение основных устройств системной платы эвм ibm pc/at Pentium
- •8.3 Основные сигналы шинного интерфейса процессора Pentium
- •8.4 Организация шины pci
- •8.4.1 Общая характеристика шины pci
- •8.4.2 Основные сигналы шины
- •8.4.3 Протокол шины pci
- •8.5 Контрольные вопросы
- •Библиографический список
7.1.2. Совмещенное адресное пространство памяти и ввода- вывода
В совмещенной системе используется общая адресация ОП и УВВ, при этом регистры УВВ с точки зрения операций записи-чтения идентичны ячейкам ОП. При адресации ПУ и ОП используются все линии ША, но под адресное пространство ОП отводится одна область, а под адресное пространство УВВ- другая область адресного пространства процессора, различающиеся значениями адресов (см. рисунок 7.2).
Рисунок 7.2- Адресация и обращение к адресным пространствам памяти и УВВ при совмещенной системе адресных шин
Достоинством совмещенного адресного пространство памяти и ввода- вывода является возможность обращения к УВВ с помощью тех же команд, что и к ОП. Недостатками его являются:
- уменьшение адресного пространства памяти;
- усложнение схем дешифрации адреса УВВ.
7.2 Организация пзу. Проектирование памяти эвм
Полупроводниковая память ЭВМ обычно включает в себя постоянную ПЗУ (Read Only Memory - ROM) и оперативную память ОЗУ (Random Access Memory - RAM). Постоянная память способна хранить информацию при отключении питания, поэтому предназначается для хранения программ и констант. В оперативной памяти при отключении питания информация теряется, поэтому в ней хранят промежуточные результаты, например данные, подлежащие обработке.
С точки зрения занесения информации в ПЗУ, т.е. их программирования, можно выделить следующие типы постоянной памяти:
- программируемые с помощью маски – программируются на стадии изготовления ПЗУ заводом-изготовителем;
- электрически программируемые ПЗУ. Программирование таких ПЗУ заключается в разрушении импульсом тока плавких перемычек неиспользуемых выводов транзисторов;
- перепрограммируемые ПЗУ (ППЗУ) называемые также репрограммируемыми (РПЗУ). Для их изготовления используют МОП- транзисторы с плавающим затвором. При записи в них информации (электрически) за счет создания большой разности потенциалов между стоком и истоком в области затвора формируется заряд, получаемый инжекцией электронов из области истока. Этот заряд может сохраняться десятки лет. Для стирания записанной информации в микросхемах РПЗУ-УФ (EPROM) используется ультрафиолетовое излучение, а в микросхемах РПЗУ-ЭС (EEPROM) стирание производится электрическим способом;
- флэш – память (Flash - Memory). По принципу действия подобна РПЗУ-ЭС. Особенностью флэш – памяти является процесс стирания информации, которое производится либо для всего объема памяти, либо для достаточно больших блоков. Это позволяет упростить управление и повысить степень интеграции микросхем флэш – памяти.
Типичная емкость микросхем ПЗУ средней степени интеграции (СИС), составляет 256, 512, 1К четырех или восьми разрядных слов. Используем условное графическое обозначение (УГО) таких ПЗУ, приведенное на рисунке 7.3.
Рисунок 7.3 - Обозначение микросхемы ПЗУ 256 x 4
Входы микросхемы Вк1 и Вк2 используются для подачи сигналов выборки кристалла. Наличие нескольких сигналов Вк (Chip Select - CS) облегчает объединение микросхем в модули большей емкости и разрядности.
При проектировании памяти ЭВМ разработчиком должна решаться задача построения памяти требуемой емкости и разрядности. Для этого предварительно выбирается микросхема (или микросхемы) памяти, удовлетворяющей требуемым условиям по емкости, быстродействию, совместимости уровней и другим характеристикам. Затем определяется необходимое число K микросхем по формуле:
где N - требуемая разрядность памяти; - требуемая емкость памяти;
n - разрядность выбранной микросхемы памяти; - ее емкость.
Рассмотрим на примере организацию страницы памяти емкостью 256 байт из микросхем, имеющих организацию 256 х 4 (см. рисунок 7.4).
Рисунок 7.4- Построение страницы памяти требуемой разрядности из микросхем меньшей разрядности
Для адресации страницы в 256 байт достаточно ША шириной восемь двоичных разрядов. Если требуется большая емкость памяти, она набирается из нескольких страниц. Страницы подключаются к шине данных в режиме временного мультиплексирования. На рисунке 7.5 показан пример построения ПЗУ емкостью 512 байт из 4-х микросхем с организацией 256 х 4. Две верхних микросхемы ПЗУ 256 х 4 составляют “Страницу 0” памяти, две нижних - “Страницу 1”. Для адресации памяти емкостью 512 байт требуется 9 двоичных разрядов, из них 8 разрядов (A7… A0) используются для адресации ячеек памяти внутри станиц, а разряд А8 используются для выборки страниц.
Рисунок 7.5 - Построение ПЗУ 512*8 из микросхем памяти 256*4
Для построения ПЗУ емкостью 1024 байт из микросхем с той же организацией потребуется 8 микросхем, разбитых на 4 страницы по 256 байт. Для выбора нужной страницы необходима дешифрация уже двух старших адресных разрядов A9 и A8.