- •1. Режимы работы усилительных элементов.
- •2. Режим класса а
- •3. Режим класса в
- •4. Режим класса с
- •5. Динамический режим работы транзистора.
- •6 . Построение сквозной динамической характеристики
- •7. Расчет коэффициента гармоник.
- •8.Основные показатели, характеризующие работу усилителя.
- •9 . Амплитудная характеристика усилителя.
- •10. Частотная характеристика усилителя.
- •11. Динамический диапазон усилителя.
- •12. Полоса пропускания усилителя.
- •13. Чувствительность усилителя.
- •14. Резистивный каскад. Принципиальная схема.
- •15. Эквивалентная схема резистивного каскада.
- •16. Частотная хар-ка резистивного каскада.
- •17. Роль разделительных конденсаторов в резистивном каскаде.
- •18. Трансформаторный каскад. Принципиальная схема.
- •19. Эквивалентная схема трансформаторного каскада.
- •20. Частотная хар-ка трансформаторного каскада.
- •21. Двухтактные каскады. Преимущества.
- •22. Двухтактный трансформаторный каскад.
- •23. Двухтактный бестрансформаторный каскад.
- •24. Коэффициент асимметрии.
- •25. Использование комплиментарных транзисторов в двухтактных схемах.
- •26. Фазоинверсный каскад.
- •27. Обеспечение равенства амплитуд выходных напряжений фазоинверсного каскада.
- •28. Обратная связь электронных схем.
- •29. Отрицательная обратная связь.
- •30. Влияние отрицательной обратной связи на коэфициент усиления.
- •31. Глубина оос.
- •32. Глубокая оос.
- •33. Схемы с оос.
- •34. Положительная обратная связь.
- •35. Самовозбуждение усилителей.
- •36. Амплитудные условия самовозбуждения.
- •39. Операционные усилители.
- •40. Построение структурной схемы усилителя.
- •41. Построение принципиальной схемы усилителя.
- •42. Выбор транзисторов для каскадов усиления.
- •43. Температурная стабилизация в транзисторных схемах.
- •44. Дискретизация аналоговых сигналов.
- •45. Теорема Котельникова.
- •46. Логические операции.
- •47. Асинхронные rs-триггеры на элементах и-не. Временные диаграммы.
- •48. Асинхронные rs-триггеры на элементах или-не. Временные диаграммы.
- •50. Временные диаграммы д-триггера.
- •51. Синхронные т-триггеры.
- •52. Временные диаграммы т-триггера.
- •54. Временные диаграммы m-s-схемы.
- •55. Регистр сдвига.
- •56. Счетчики импульсов.
- •57. Однофазные выпрямители. Принцип действия.
- •58. Однополупериодный выпрямитель с активной нагрузкой.
- •59.Однополупериодный выпрямитель с активно-индуктивной нагрузкой.
- •60. Однофазный выпрямитель с нулевым выводом.
- •61.Мостовая схема выпрямителя.
- •62 Сглаживающие г-образные фильтры.
- •63 Сглаживающие г-образные фильтры.
- •65. Стабилизаторы.
- •66. Параметрические стабилизаторы.
- •67. Компенсационные стабилизаторы.
- •68. Автогенераторы.
50. Временные диаграммы д-триггера.
Основой микропроцессорной техники является триггер, который имеет 2 устойчивых состояния равновесия и переходит из одного состояния в другое с помощью внешних импульсов. Триггер позволяет определить состояние в предыдущем цикле и позволяет определить состояние в текущем времени. Поэтому основной узел оперативной памяти состоит из триггеров.
Д-триггер (delay-задержка) имеет прямые или инверсные установочные входы R и S, один управляющий вход D и вход синхронизации C. Входы R и S называются установочными и служат для предварительной установки Д-триггера в состояние Q=1 или Q=0. Сигнал на управляющем входе D=1 или D=0 устанавливает триггер в устойчивое состояние с одноимённым значением на прямом информационном выходе Q=1 или Q=0 только при одновременном действии импульса положительной полярности на входе синхронизации. Обычно переключение триггера происходит в течении времени действия переднего фронта импульса синхронизации.
51. Синхронные т-триггеры.
Триггером T - типа (счетный триггер) называют логическое устройство с двумя устойчивыми состояниями и одним входом (T), изменяющее свое состояние на противоположное всякий раз, когда на вход T поступает управляющий (счетный) сигнал.
Функционирование Т - триггера описывается следующим характеристическим уравнением:
Этому уравнению соответствует таблица переходов T - триггера (табл.5), т.е. из таблицы видно, что состояние триггера меняется на противоположное с приходом сигнала по входу T.
основе JK-триггеров и D-триггеров можно построить схемы, осуществляющие так называемый счетный режим. Такие схемы называют Т-триггерами или счетными триггерами, связывая с этим способ их функционирования. На рис. 1.10 представлены схемы организации Т-триггера на основе JK и D-триггеров. Счетный режим иллюстрируется временными диаграммами рис.
В JK-триггере со входами установки логическим нулем счетный режим реализуется путем подачи констант J=K=1 и R=S=1 и входного сигнала Т на вход С. В соответствии с таблицей функционирования при каждом отрицательном перепаде входного сигнала Т состояние триггера изменяет свое значение на противоположное. В D-триггере счетный режим реализуется при помощи обратной связи (на вход D подается сигнал с инверсного выхода). Таким образом, всегда существует неравенство сигнала на входе D и сигнала на выходе Q: если Q=1, D=0. Следовательно, при каждом положительном перепаде сигнала на счетном входе С, в соответствии с принципом действия D-триггера состояние выхода будет изменяться на противоположное. Таким образом, на каждые два входных тактовых импульса Т-триггер формирует один период выходного сигнала Q. Следовательно, триггер осуществляет деление частоты fт на его входе на 2: f0=FT/2, где fQ — частота следования импульсов на выходе триггера.
52. Временные диаграммы т-триггера.
Триггером T - типа (счетный триггер) называют логическое устройство с двумя устойчивыми состояниями и одним входом (T), изменяющее свое состояние на противоположное всякий раз, когда на вход T поступает управляющий (счетный) сигнал.
Функционирование Т - триггера описывается следующим характеристическим уравнением:
Этому уравнению соответствует таблица переходов T - триггера (табл.5), т.е. из таблицы видно, что состояние триггера меняется на противоположное с приходом сигнала по входу T.
основе JK-триггеров и D-триггеров можно построить схемы, осуществляющие так называемый счетный режим. Такие схемы называют Т-триггерами или счетными триггерами, связывая с этим способ их функционирования. На рис. 1.10 представлены схемы организации Т-триггера на основе JK и D-триггеров. Счетный режим иллюстрируется временными диаграммами рис.
В JK-триггере со входами установки логическим нулем счетный режим реализуется путем подачи констант J=K=1 и R=S=1 и входного сигнала Т на вход С. В соответствии с таблицей функционирования при каждом отрицательном перепаде входного сигнала Т состояние триггера изменяет свое значение на противоположное. В D-триггере счетный режим реализуется при помощи обратной связи (на вход D подается сигнал с инверсного выхода). Таким образом, всегда существует неравенство сигнала на входе D и сигнала на выходе Q: если Q=1, D=0. Следовательно, при каждом положительном перепаде сигнала на счетном входе С, в соответствии с принципом действия D-триггера состояние выхода будет изменяться на противоположное. Таким образом, на каждые два входных тактовых импульса Т-триггер формирует один период выходного сигнала Q. Следовательно, триггер осуществляет деление частоты fт на его входе на 2: f0=FT/2, где fQ — частота следования импульсов на выходе триггера.
53. Т-триггеры (M-S схема).
Основой микропроцессорной техники является триггер, который имеет 2 устойчивых состояния равновесия и переходит из одного состояния в другое с помощью внешних импульсов. Триггер позволяет определить состояние в предыдущем цикле и позволяет определить состояние в текущем времени. Поэтому основной узел оперативной памяти состоит из триггеров.
Триггер со счетным запуском.
M-S-схема. Синхронный триггер.Master – основной.
Slave – вспомогательный