- •А.Д. Чередов организация эвм и систем
- •Введение
- •Архитектуры, характеристики, классификация эвм
- •1.1. Однопроцессорные архитектуры эвм
- •Название фирм и разработанных ими risc-процессоров
- •Максимальное и среднее число команд, выполняемых в одном машинном цикле
- •1.2. Технические и эксплуатационные характеристики эвм
- •Результаты тестирования процессоров
- •1.3. Классификация эвм
- •1.3.1. Классификация эвм по назначению
- •1.3.2. Классификация эвм по функциональным возможностям и размерам
- •Сравнительные параметры различных классов эвм
- •Функциональная и структурная организация эвм
- •2.1. Связь между функциональной и структурной организацией эвм
- •2.2. Обобщенная структура эвм и пути её развития
- •Обрабатывающая подсистема
- •Подсистема памяти
- •Подсистема ввода-вывода
- •Подсистема управления и обслуживания
- •2.3. Структура и форматы команд эвм
- •Способ расширения кодов операции
- •2.4. Способы адресации информации в эвм
- •Классификация способов адресации по наличию адресной информации в команде Явная и неявная адресация
- •Классификация способов адресации по кратности обращения в память
- •Непосредственная адресация операнда
- •Прямая адресация операндов
- •Косвенная адресация операндов
- •Классификация способов формирования исполнительных адресов ячеек памяти
- •Относительная адресация ячейки оп Базирование способом суммирования
- •Относительная адресация с совмещением составляющих аи
- •Индексная адресация
- •Стековая адресация
- •2.5. Примеры форматов команд и способов адресации
- •2.5.1. Форматы команд и способы адресации в cisc-процессорах
- •Развитие системы команд процессоров архитектуры Intel
- •Общий формат команд
- •Способы адресации
- •2.5.2. Форматы команд и способы адресации в risc-процессорах
- •2.6. Типы данных
- •Данные со знаком
- •3. Функциональная и структурная организация центрального процессора эвм
- •3.1. Назначение и структура центрального процессора
- •3.2. Регистровые структуры центрального процессора
- •4. Регистры отладки и тестирования.
- •3.2.1. Основные функциональные регистры
- •Регистры общего назначения
- •Регистры сегментов и дескрипторы сегментов
- •Указатель команд
- •Регистр флагов
- •3.2.2. Регистры процессора обработки чисел с плавающей точкой
- •3.2.3. Системные регистры
- •3.2.4. Регистры отладки и тестирования
- •3.3. Назначение, классификация и организация цуу
- •3.3.1. Центральное устройство управления микропрограммного типа
- •3.3.2. Процедура выполнения команд
- •3.3.3. Принципы организации системы прерывания программ
- •Характеристики системы прерывания
- •Программно–управляемый приоритет прерывающих программ
- •Организация перехода к прерывающей программе
- •3.4. Назначение, классификация и организация алу
- •Классификация алу
- •Обобщенная структурная схема алу
- •Методы повышения быстродействия алу
- •4. Принципы организации подсистемы памяти эвм и вс
- •4.1. Иерархическая структура памяти эвм
- •4.2. Организация внутренней памяти процессора
- •4.3. Способы организации кэш-памяти
- •4.3.1. Общие сведения
- •Типовая структура кэш-памяти
- •4.3.2. Способы размещения данных в кэш-памяти
- •Прямое распределение
- •Полностью ассоциативное распределение
- •Частично ассоциативное распределение
- •Распределение секторов
- •4.3.3. Методы обновления строк основной памяти
- •Условия сохранения и обновления информации
- •Сквозная запись
- •Обратная запись
- •4.3.4. Методы замещения строк кэш-памяти
- •4.4. Принципы организации оперативной памяти
- •4.4.1. Общие положения
- •4.4.2. Методы управления памятью
- •Типы адресов
- •Распределение памяти фиксированными разделами
- •Распределение памяти разделами переменной величины
- •Перемещаемые разделы
- •4.4.3. Организация виртуальной памяти
- •Страничное распределение
- •Сегментное распределение
- •Странично-сегментное распределение
- •Свопинг
- •4.4.4. Методы повышения пропускной способности оперативной памяти
- •Выборка широким словом
- •Расслоение обращений
- •4.4.5. Методы защиты памяти
- •Защита памяти по граничным адресам
- •Защита памяти по маскам
- •Защита памяти по ключам
- •4.4.6. Методы ускорения процессов обмена между оп и взу
- •5. Принципы организации подсистемы ввода-вывода
- •5.1. Проблемы организации подсистем ввода-вывода
- •5.2. Способы организации передачи данных
- •Прямой доступ к памяти
- •5.3. Унификация средств обмена и интерфейсы эвм
- •5.3.1. Общая характеристика и классификация интерфейсов
- •5.3.2. Типы и характеристики стандартных шин
- •Характеристики стандартных шин
- •5.4. Современные и перспективные структуры подсистем ввода-вывода
- •6. Многопроцессорные и многомашинные вычислительные системы
- •6.1. Архитектуры вычислительных систем
- •6.2. Сильно связанные многопроцессорные системы
- •6.3. Слабосвязанные многопроцессорные системы
- •Список использованной литератуРы
- •Оглавление
3.2. Регистровые структуры центрального процессора
Набор регистров и их структуры рассмотрим на примере процессоров с интеловской архитектурой. Можно выделить следующие группы регистров:
Основные функциональные регистры:
регистры общего назначения (РОНы);
указатель команд;
регистр флагов;
регистры сегментов.
Регистры процессора обработки чисел с плавающей точкой (FPU):
регистры данных;
регистр тегов;
регистр состояния;
регистр указателей команд и данных FPU;
регистр управления FPU.
Системные регистры:
регистры управления микропроцессора;
регистры системных адресов.
4. Регистры отладки и тестирования.
Все 16-разрядные регистры микропроцессоров 8086, 80186, 80286 входят в состав набора 32-разрядных регистров. Регистры первых двух групп используются при выполнении прикладных программ, третьей группы — системных, четвертой — при отладке и тестировании.
3.2.1. Основные функциональные регистры
Содержимое этих регистров определяется текущей задачей, т.е. в эти регистры автоматически загружается новое значение при переключении задач.
Регистры общего назначения
Восемь 32-разрядных регистров предназначены для хранения данных и адресов. Они поддерживают работу с данными разрядностью 1, 8, 16, 32 и 64 бита, битовыми полями длиной от 1 до 32 бит и адресами размером 16 и 32 бита. Младшие 16 разрядов этих регистров (рис. 3.3) доступны отдельно при использовании соответствующего имени, например регистр ЕАХ (имя АХ для 16 разрядов).
31 16 |
15 A |
X 0 |
|
|
AH |
AL |
EAX |
Рис. 3.3. Структура регистра общего назначения ЕАХ
При операциях с байтами можно отдельно обращаться к младшему байту (разряды 0 – 7) и старшему байту (8 – 15) по именам AL и AH. Доступ к отдельным байтам обеспечивает дополнительную гибкость при операциях с данными.
Регистры сегментов и дескрипторы сегментов
Шесть 16-разрядных сегментных регистров (CS, SS, DS, ES, FS, GS) содержат значения селекторов сегментов, указывающих на текущие адресуемые сегменты памяти. С каждым из них связан программно-недоступный регистр дескриптора сегмента (рис. 3.4).
В защищенном режиме каждый сегмент может иметь размер от 1 байта до 4 Гбайт, в режиме реальных адресов максимальный размер сегмента составляет 64 Кбайта.
Селектор в CS обеспечивает обращение к текущему сегменту команд, селектор в SS — к текущему сегменту стека, селекторы в DS, ES, FS, GS — к текущим сегментам данных. Каждый регистр дескриптора содержит 32-разрядный размер сегмента и другие необходимые атрибуты.
Когда в регистр сегмента загружается новое значение селектора, содержимое соответствующего регистра дескриптора автоматически корректируется. В реальном режиме базовый адрес сегмента получается путем сдвига значения селектора на 4 разряда влево (20 разрядов), максимальный размер и атрибуты сегмента в реальном режиме имеют фиксированные значения.
Регистры сегментов |
Регистры дескрипторов | |||||||||||
|
|
|
|
|
|
| ||||||
|
15 0 |
|
|
Базовый адрес |
Размер сегмента |
Другие атрибуты | ||||||
|
Селектор |
|
CS |
|
|
|
|
|
|
|
| |
|
Селектор |
|
SS |
|
|
|
|
|
|
|
| |
|
Селектор |
|
DS |
|
|
|
|
|
|
|
| |
|
Селектор |
|
ES |
|
|
|
|
|
|
|
| |
|
Селектор |
|
FS |
|
|
|
|
|
|
|
| |
|
Селектор |
|
GS |
|
|
|
|
|
|
|
|
Рис. 3.4. Регистры сегментов и соответствующие регистры дескрипторов