Добавил:
Upload Опубликованный материал нарушает ваши авторские права? Сообщите нам.
Вуз: Предмет: Файл:

material1 / different / Chung-Yu Wu - Analog Circuit Design

.pdf
Скачиваний:
51
Добавлен:
05.06.2015
Размер:
29.49 Mб
Скачать

 

 

 

 

 

!

 

 

 

 

 

 

!

 

 

 

∆ =

" − =

-

& "

(8# − 8! " )

 

-

&

(8# − 8! )

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

"

= "

 

 

 

 

"

 

=

 

 

 

 

 

-&

 

 

!

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

∆!

 

 

 

∆=

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

=

 

 

(8#

 

8! )

∆-&

+

 

 

 

 

"∆8!

 

 

 

 

 

 

 

 

 

 

 

 

"

 

 

=

 

 

 

 

 

-&

 

 

 

!

 

 

=

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

8# − 8!

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

∆!

 

=

 

 

 

 

 

 

 

 

 

"∆8!

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

=

∆-&

 

+

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

-&

 

 

 

!

 

 

=

 

 

 

8#

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

8!

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

∆=

 

∆!

 

 

 

∆-

 

 

 

 

∆-&

 

 

∆!

 

 

∆=

 

∆8!

 

 

 

 

 

 

 

 

 

 

 

 

 

" =

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

8%# =

∆8! +

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

+

 

 

 

+

 

 

 

 

 

 

 

 

 

 

 

 

-

 

!

 

 

 

 

 

 

 

 

 

 

 

"!

 

"-

"-&

 

 

"!

 

"=

8# − 8!

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

"=

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

∆!

 

 

 

 

 

∆=

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

∆=

 

 

 

∆!

 

 

∆8! + (8#

 

 

 

 

 

 

 

 

 

 

 

 

-&

 

!

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

+

 

 

 

 

 

 

 

 

 

∆8!

 

 

→ 9

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

8!)

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

"!

 

 

 

 

 

"=

 

 

 

- !

 

 

 

 

 

 

 

 

 

 

 

"= "!

 

" % 8%#

=

8%

8%

 

 

9 ?%

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

?%

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

$D ?#D

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

, & ' ' ! "#

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

=

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

"

 

 

 

 

?

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

"

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

"?

 

 

 

 

 

 

 

 

 

 

 

"U

 

 

 

 

 

 

 

 

 

"U

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

"U

 

 

0U

 

 

 

 

 

 

"U

 

 

 

 

 

0U

 

 

 

 

 

 

 

 

 

 

 

0U

 

 

 

 

 

 

 

 

 

 

 

 

0U

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

"?

 

?

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

4 )

 

 

 

 

 

 

 

 

 

 

 

 

"

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

"U

 

 

 

"U

 

"

 

?

 

 

 

 

 

 

"?

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

0U

 

 

 

 

0U

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

"?

?

"U

 

0U

 

 

"U

 

 

0U

 

 

 

 

 

#

8'

!

=

=

-=

= "

= -="

 

=

=

=

=

: !Q

 

 

 

 

 

=

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

= "

="

 

 

 

 

2 4 ) 3 # " +

#

=

# " +

#

 

 

 

 

 

 

 

 

8#

+ 8#

=

8#

+

 

8#

 

8#

 

+ -:

 

 

 

 

 

 

 

="

 

=

 

= "

 

 

=

 

 

 

8#

 

 

- + :

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

8#

 

-* *+ )

 

$

 

 

 

 

 

 

 

 

 

 

 

8#

 

 

9

8%#

9

 

 

 

 

 

 

 

 

-* :*

"

8#

= 99"0

 

 

 

 

 

 

 

8#

 

 

 

 

 

 

4) "

? "?

 

 

 

 

8# =

- =

= 9/H 8# " 8%#

 

 

 

 

8#

 

 

 

 

 

 

 

 

. 3 .2? . 0H )) "G94"EE K HE1

 

 

2 4 ∆8!

 

 

. 3

''' K%%2 %24 0 )) EH 4EH1 HE1

''' K%%2 %24 I )) II 4II1 H1

" , )

 

 

%

 

 

 

G

4

 

"

% )

 

 

 

I

%

 

0

% ) J

 

 

E

%

 

/

#

 

 

1

: J

 

. 3 ''' K%%2 %24"9 )) IGE4IIG K H1G

0 = 8# − 8!

/

 

! @ ="

=

! @ =

=

 

 

! @ =

 

" 8 = 9 " ≈ 9

 

! @ =(

 

 

 

 

! @ =(

 

" ! @ =

 

 

( ) 4 =( = =" = =

D#$% #" # :#$% #" # D#$%4 )

"? )

G % ) 4

. 3 ''' K%%2 ) /HH ? HE1

''' K%%2 %24 9 )) 0E 40EH HEG

''' K%%2 %24"9 )) 19G419E K H1G

''' K%%2 %24 E )) 9914 9 0 H1I

''' K%%2 %24 I )) E/G4E/1 H1

''' K%%2 )) 10E41// ? H1G

?)) 3 R 4$D ?#D 7 4) )

) 7 4) )

% 4 ) ) % 4 ) ;

$ $D4?#D4 4 ) %2 )

%2 )

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

%

 

 

 

 

α 2

 

2

 

 

 

 

 

 

 

 

8

 

 

 

 

 

 

 

"

$D?#D

 

8

 

 

 

 

"

 

 

 

 

 

 

 

5

 

 

 

 

 

8

 

 

 

 

 

 

4

 

 

 

 

 

α +

=

= α

+

 

 

 

 

 

 

 

 

" # %2 ? )

 

 

 

 

 

 

 

2

 

 

 

 

 

 

 

 

 

 

 

 

 

"

 

 

 

 

 

 

 

 

 

 

α 2

 

%

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

8

 

 

 

"

 

 

 

 

 

 

 

 

"

$D?#D

 

 

 

 

 

 

 

 

8

 

 

 

 

 

 

 

5

 

 

 

 

 

 

8

 

 

 

 

 

 

4

 

 

 

 

 

% ) 3 %$: % "$&&3

 

α 2

 

 

8

 

 

5

4

$D?#D

×

 

5

×

 

 

8

 

 

 

5

 

8

 

8

 

 

4

4

 

% ) "3 % "$: %$&&3

5

8 4

 

 

 

 

 

 

 

2

 

 

9

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

α 2

 

 

9

 

 

 

 

 

 

 

 

 

*

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

!3 !

 

 

 

,

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

5

 

 

 

 

 

 

 

 

 

 

8

 

 

 

 

 

 

 

 

 

 

 

4

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

α + − =

 

 

 

 

 

 

 

 

 

 

 

( T %

" $) )

 

 

 

 

 

>

/

 

 

 

 

 

,

/

/

* * ,

 

 

 

 

 

 

 

 

,

 

 

 

 

 

 

 

 

 

 

 

 

 

/

 

 

 

 

 

 

 

 

 

 

2 ) ,

 

 

 

 

/

 

 

 

 

 

 

 

 

 

 

 

 

 

3 ε = 9

 

 

 

 

 

 

 

 

 

 

 

+

 

 

 

 

 

 

 

 

 

=

9

 

 

 

 

 

 

 

&,

 

ε

9

 

 

 

 

 

 

 

= 9

 

 

 

 

 

 

 

 

 

 

 

9 +

9999

 

 

) J

=

99µ

 

 

 

 

 

 

 

 

 

 

J .%#

 

ε

 

 

 

 

 

 

 

 

 

 

 

)

 

 

)

 

 

 

 

 

 

 

4J

 

)

 

 

 

 

 

)) 4 J

 

 

) </

ε

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

.%# ) D4#$%&'(

 

 

 

 

 

 

 

 

 

 

 

2

"

 

2"

0

 

 

 

 

 

 

 

 

 

 

 

 

%

 

%"

 

 

 

 

 

 

 

 

B5

 

 

 

%0

%/

 

%?

 

 

 

 

 

 

 

 

 

 

φ"

φ0

φ/

$:

 

$&

 

 

 

 

 

= + ε @

3 )

ε 3 ) ; )

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

8 - 1

CHUNG-YU WU

Chapter 8 Advanced Design Techniques and Recent

Design Examples of CMOS OP AMPs

§8-1 Advanced Design Techniques of CMOS OP AMPs

§8-1.1 Improved PSRR and frequency compensation

 

V

 

 

 

 

C gs

 

é ¶I

o

 

 

 

 

 

1

 

 

 

 

 

V

 

ù C gd

1

 

I

o

 

P.6-26

 

out

»

 

 

 

ê

 

 

 

 

 

 

 

 

 

 

 

+

 

 

 

 

GS1

ú +

 

 

 

 

 

 

 

 

 

 

 

 

V

ss

 

C

I

V

ss

 

 

2g

 

 

 

 

 

V

 

 

C

I

 

2 g

m3

 

V

ss

 

 

 

 

 

 

 

 

ë

 

 

 

 

 

 

 

m1

 

 

 

ss

 

û

 

 

 

 

 

 

 

 

 

 

 

V

 

 

»

 

C gd

é

 

 

 

 

I

o

 

1

ù

 

C gs

 

 

 

1

 

 

 

 

I

o

 

 

 

 

 

out

 

 

 

 

 

1 -

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

+

 

 

 

 

 

 

 

 

 

 

 

 

 

VDD

 

 

 

 

 

 

 

ê

 

 

VDD

 

 

 

 

 

 

 

ú

 

C I 2 g m1 VDD

 

 

 

 

 

 

 

C I ë

 

 

2g m3 û

 

 

 

 

 

 

 

 

Where

 

Io

 

 

represents the input stage bias current.

If Io

is independent of

 

 

Vss

 

and

VDD

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

and the input devices have no body effect.

 

 

 

 

 

 

 

 

 

 

 

 

 

V

 

 

® 0

 

 

 

V

 

 

 

 

® -

C gd

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

==>

 

 

out

 

 

 

 

out

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

VDD

 

C I

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

Vss

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

Ref.: IEEE JSSC, vol. SC-15, pp.929-938, Dec. 1980

 

 

BIAS GENERATOR

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

+VDD

 

 

 

 

 

OP AMP

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

M9

M3

M4

M6

IREF

 

 

 

M10

V-

 

V+

M1

M2

Vo

 

 

M8

 

 

Io

M11

 

 

 

 

 

M12

M7

 

M5

 

VBIAS

 

 

-VSS

 

* I REF

is generated by using the power supply independent current source.

*VBIAS

is nearly independent of VDD

and

Vss .

*It is better to use separate p-wells for

M 1

and M 2 to avoid the body effect.

8 - 2

CHUNG-YU WU

*Tracking RC compensation

Conceptual circuits :

 

 

 

 

+VDD

 

 

 

 

 

+

 

 

+

gm1VIN

VIN2

 

 

 

-

MB(M6)

 

Vos2

 

 

 

 

 

 

 

-

 

 

 

 

Voltage

Mc

 

 

 

 

source

 

 

 

CC

(M10)

 

 

 

 

 

 

 

CL

 

 

 

 

 

MA(M8)

 

I

 

 

 

(RC)

 

 

 

 

KI

 

 

 

 

-VSS

 

In the quiescent case ,Vin2=VOS2

 

 

 

If (W / L)A ≈ [(W / L)B

∙ (W / L)C

K]1/ 2 Cc

 

 

 

 

 

Cc + CL

 

=> R Cc + CL

Rc

 

 

dsA

gm 2Cc

 

 

 

 

 

 

 

 

The requires Rc is Rc = 1 / gm2 [1 + (Cd + CL ) / Cc] » 1 / gm 2[(Cc + C L ) / CC ] Thus LHP zero=LHP pole P2

and P3 becomes the second pole.

The stability considerations,

 

P3 ³ Ado P1

 

or

Cc ³

gm1

c1cL

gm 2

 

 

 

allows a smaller gm2 and larger C L

* RdsA » Rc indep of temperature, process , and supply variations. =>Tracking design to make sure that z=P2

=>No pole-zero doublet problem!

8 - 3

CMOS Design

CHUNG-YU WU

 

+VDD

M1

M3

 

 

 

 

M5

M8

 

M13

 

VBIAS

 

 

 

 

-

 

+

M15

 

M9

M11

 

 

 

Vout

 

 

 

 

 

M6

 

 

Cc

 

 

 

M17

 

M2

M7

 

 

M16

 

 

 

 

M10

M12

 

M14

 

M4

 

 

 

-VSS

*M17,Cc : Tracking RC compensation.

*M9,M11:Sharing the separate n-well.

*VBIAS is not strictly independent of VDD and VSS.

§8-1.2 Improved frequency compensation technique.

Ref.: IEEE JSSC ,vol.sc-18, pp 629-633, Dec.1983

Grounded gate cascode compensation

+VDD

M11

M12

 

M5

M9

 

 

 

2x

3x

 

 

 

VBIAS1

 

MB

 

 

 

 

 

M7

M13

+

M1

M2

-

 

 

 

 

 

 

IBIAS

VBIAS2

 

 

 

Cc

 

 

MC1

MC2

M8

Vo

 

M16

5pF

 

 

 

3x

 

 

M14

M15

M3

M4

M10

 

M6

3x

 

 

 

 

 

 

 

 

 

VBIAS1

 

 

 

MB,Cgs7:low pass filter for high frequency noises. M8,M9,M10:new compensation circuit. M11~M16:Bias generator.

Conceptual circuits:

 

+VDD

 

 

2Io

CS1

I1

Cc

_

 

A

 

 

 

 

gm1

 

 

-gm2

+

 

Vi

CS2

 

R1

I1

 

-VSS

8 - 4

CHUNG-YU WU

Vo

R2

Net current in CC

(C

 

d

V

 

) enters the second stage.

c

 

o

 

 

dt

 

The input voltage Vi can’t reach the node A

è* Better PSRR ( no low-freq. zero ) , especially PSRR

*Allow larger capacitive loads.

*Slight increase in complexity , random offset and noise.

§8-1.3 Improved cascode structure

1.To improve gain:

Ref: IEEE JSSC , vol. SC-17, pp. 969-982, Dec. 1982

 

+VDD

 

M1

M2

 

 

M9

 

 

 

Vo

M1A

Rc

Cc

M2A

 

 

 

 

M7

 

 

M4A

M6

 

M3A

 

 

 

M4

 

 

M8

 

 

M3

 

 

-VSS

 

8 - 5

CHUNG-YU WU

*Substantial reduction in input-stage common-mode range.

*Improved wilson current source is used as the load to improve the balance of the

first stage.

2.Single-stage push-pull class AB CMOS OP AMP Ref: IEEE JSSC , vol.sc-17, pp.969-982, Dec. 1982

*Inverting mode only. (+ grounded)

*Capable of high current driving and

high voltage gain.

IN

*Not a differential-amplifier-based OP AMP.

_

+

3.Cascoded CMOS OP AMP with high ac PSRR

Ref: (1) IEEE JSSC , vol. SC-19, pp.55-61, Feb. 1984

(2)IEEE JSSC , vol SC-19, pp. 919-925, Dec. 1984

1)Original version

+VDD

M6

M5

M7

M2

M4

M1

M3

 

 

 

 

 

BIAS

OUT

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

Cc

M8

M10

M9

-VSS

 

 

 

 

+VDD

 

 

 

 

 

 

200/10

 

200/10

 

25/10

 

 

 

 

Mp2

 

Mp3

 

Mp4

 

 

 

 

 

 

 

 

 

A

1125/10

 

 

 

 

 

 

 

Mp5

 

 

 

 

 

 

Mp7

100/10

 

 

50/10

 

50/10

 

 

 

 

 

 

 

Mp5

Cc

Vout

 

 

-

MN1

MN2

+

IBIAS

 

100/10

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

CL

5μA

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

100/10

 

 

 

200/10

 

MN5

42.5/10

MN8

MN9

MN3

100/10

MN4

100/10

 

MN642.5/10

MN7

500/10

 

 

 

 

 

 

 

-VSS

Chrarcteristics:

 

VDD=VSS=2.5V

 

Input offset voltage

5mV

Supply current

100ìA

Output voltage range

-VSS~VDD

Input common mode range

-VSS+1.47V ~ VDD

CMRR @ 1KHz

99dB

Unity-gain frequency

1.0MHz

Slew rate

1.8 V/ìsec

Соседние файлы в папке different