- •Содержание
- •1. Теоретические основы построения узлов эвм
- •1.1. Физические формы представления информации
- •1.2. Математические модели схем эвм
- •1.3. Элементы и узлы эвм
- •1.3.1. Логические элементы
- •1.3.2. Основные характеристики логических элементов
- •Основные характеристики логических элементов
- •1.3.3. Триггеры
- •Классификация триггеров
- •Асинхронные триггеры
- •1.3.4. Регистры
- •1.3.5. Счетчики
- •Двоичные счетчики
- •Асинхронные счетчики
- •1.3.6. Дешифратор
- •1.3.7. Мультиплексор
- •2. Процессоры и микропроцессоры
- •2.1. Основные принципы построения устройств обработки цифровой информации
- •2.2. Принципы организации арифметико-логических устройств
- •Классификация алу
- •2.3. Структура и формат команд. Кодирование команд.
- •2.4. Способы адресации
- •2.5. Запоминающие устройства эвм
- •Адресная, ассоциативная и стековая организация памяти
- •Адресная память
- •Ассоциативная память
- •Стековая память
- •Запоминающие устройства типа 2d
- •Запоминающие устройства типа 3d
- •Статические и динамические озу
- •Постоянные запоминающие устройства
- •2.6. Принципы организации систем обработки прерывания программ
- •Допустимые моменты прерывания программ
- •Число классов (уровней) прерываний
- •Приоритетное обслуживание запросов прерывания
- •Процедура прерывания с опросом источников прерывания
- •Циклический опрос источников прерываний
- •Цепочечная однотактная схема определения приоритетного запроса
- •Векторное прерывание
- •Программное управление приоритетом
- •3. Организация ввода/вывода в эвм
- •3.2. Системные и локальные шины
- •3.3. Шины ввода/вывода
- •3.3.1. Шина agp
- •3.3.2. Шина usb
- •3.3.3. Шины ide и scsi
- •4. Вычислительные системы
- •4.1. Классификация вычислительных систем
- •4.2. Многомашинные вычислительные системы
- •4.3. Многопроцессорные вычислительные системы
- •5. Сети компьютеров
- •5.1. Основные понятия
- •5.2. Локальные вычислительные сети
- •5.2.1. Базовая модель osi (Open System Interconnection)
- •5.2.2. Сетевые устройства и средства коммуникаций
- •5.2.3. Топологии вс
- •5.2.4. Типы построения сетей по методам передачи информации
- •5.3. Сетевой и транспортный уровни
- •5.3.1. Транспортные и сетевые протоколы
- •5.3.2. Управление потоками данных в сетях
- •5.3.3. Мостовые соединения
- •5.3.4. Маршрутизация
- •5.3.5. Транспортный протокол тср в стеке протоколов tcp/ip
- •5.3.6. Коммутационное оборудование
- •5.3.7. Сетевой протокол ip в стеке протоколов tcp/ip.
- •5.3.8. Другие протоколы в стеке tcp/ip
- •5.3.9. Адресация в tcp/ip (в Internet)
- •5.3.10. Протоколы управления в стеке tcp/ip
- •5.3.11. Сети атм
- •5.3.12. Интеллектуальные сети связи
- •5.3.13. Функциональные серверы
- •5.3.14. Информационная безопасность в сетях
- •5.3.15. Распределенные вычисления (рв)
- •5.3.16. Технологии распределенных вычислений
- •5.3.17. Рекомендации по проектированию корпоративных сетей
- •5.4. Структура и функции территориальных сетей
- •5.4.1. Структура территориальных сетей
- •5.4.2. Протоколы теледоступа
- •5.4.3. Электронная почта
- •5.4.4. Файловый обмен
- •5.4.5. Телеконференции и "доски объявлений"
- •5.4.6. Видеоконференции
- •5.4.7. Стандарты конференц-связи
- •5.4.8. Доступ к распределенным базам данных
- •5.4.9. Информационная система www
- •5.4.10. Разделяемые виртуальные миры (Sharing Virtual Worlds)
- •5.4.11. Способы доступа к Internet
- •6. Микроконтроллеры
- •6.1. Определение микроконтроллера
- •6.2. Классификация микроконтроллеров
- •6.3. Тенденции в развитии современных микроконтроллеров
- •6.4. Оценка быстродействия мк
- •6.5. Энергосберегающие мк ведущих производителей
Запоминающие устройства типа 3d
Некоторые ЗЭ имеют два входа выборок. Чтобы выполнялась операция выборки, требуется наличие сигнала выборки на обоих входах. Использование таких элементов позволяет строить ЗУ с трехкоординатным выделением ячеек.
Запоминающий массив ЗУ типа 3D представляет собой пространственную матрицу (рис. 2.3), составленную из n плоских матриц, представляющих собой запоминающий массив для отдельных разрядов ячеек памяти. Запоминающие элементы для разряда сгруппированы в квадратную матрицу.
Рис.
2.3.
Для адресной выборки запоминающего элемента выдается две его координаты в массиве. Код ячейки памяти разделяется на старшую и младшую части, каждая из которых поступает на свой адресный формирователь. Адресные формирователи выдают код в соответствующие адресные линии. В результате в массиве оказывается выбранным элемент, находящийся на пересечении двух адресных линий. Адресные формирователи управляются сигналами "Чтение" и "Запись" и в зависимости от них выдают сигналы выборки для считывания или для записи. При считывании сигнал о состоянии выбранного элемента поступает по линии считывания в усилитель. При записи в запоминающий элемент будет занесена информация, поступившая с соответствующего усилителя записи.
Для полупроводниковых ЗУ характерно объединение в одну линию разрядных линий записи и считывания.
Запоминающие устройства типа 3D более экономичны, чем ЗУ 2D. Однако элементы с тремя входами, используемыми при записи не всегда удается реализовать.
Статические и динамические озу
Микросхемы ОЗУ по типу элементов памяти разделяют на статические и динамические. В микросхемах статических ОЗУ в качестве элементов памяти применены статические триггеры на биполярных или МДП-транзисторах. Как известно, статический триггер способен при наличии напряжения питания сохранять свое состояние неограниченное время. Число состояний, в которых может находиться триггер, равно двум, что и позволяет использовать его для хранения двоичной единицы информации.
В микросхемах динамических ОЗУ элементы памяти выполнены на основе электрических конденсаторов, сформированных внутри полупроводникового кристалла. Для обеспечения сохранности информации необходимо периодическое восстановление (регенерация) заряда конденсатора, поскольку из-за токов утечки запоминающий конденсатор может разряжаться. Это осуществляется с помощью периодических циклов регенерации, во время которых информация из элементов памяти считывается и вновь записывается обратно. Периодичность восстановления информации в элементах памяти называется периодом регенерации. Период регенерации Трег резко уменьшается с увеличением температуры окружающей среды. Длительность циклов регенерации обычно равна длительности циклов считывания или записи информации, но для полной регенерации информации в микросхеме необходимо несколько сотен таких циклов.
Микросхемы динамических ОЗУ отличаются от микросхем статических ОЗУ большей информационной емкостью, что обусловлено меньшим числом компонентов в одном элементе памяти, и, следовательно, более плотным их размещением в полупроводниковом кристалле. Однако динамические ОЗУ сложнее в применении, поскольку нуждаются в организации принудительной регенерации, в дополнительном оборудовании и более сложных устройствах управления.
Микросхемы статических ОЗУ применяются для создания сверхоперативной памяти ЭВМ, а также в устройствах автоматики, микроконтроллерах и т.п.
С точки зрения разработчика электронной аппаратуры тип ОЗУ гораздо важнее его внутренней организации, так как использование динамических ОЗУ значительно усложняет схему разрабатываемого устройства и моделирование его работы в процессе разработки. Обычно регенерация требует прерывания работы процессора и поглощает часть процессорного времени (5 - 10%), что крайне нежелательно в системах реального времени.
