- •2 Микропроцессор i80386
- •2.1.1 Программная модель 32-х разрядных
- •Отметим, что команды умножения знаковых и беззнаковых 32-х битовых целых чисел образуют 64-х битовое произведение, а команды деления рассчитаны на 64-х битовое делимое.
- •2.3.1 Режимы (методы) адресации
- •Базово-индексная адресация с отклонением. –
- •2.3.2 Использование сегментных регистров
- •2.3.3 Форматы команд
- •2.3.4 Кодирование режимов адресации
- •Команды передачи данных
- •Команды обработки цепочек
- •Команды работы с флагами (флажковые команды)
- •Команды передачи управления
- •Команды прерывания
2 Микропроцессор i80386
Основные цели разработки I80386 – пропорциональное улучшение всех технических характеристик при сохранении программной совместимости в объектных кодах с МП I8086/186/286.
Основные преимущества:
полная 32-х разрядная архитектура;
возможность параллельной работы нескольких программ, работающих под управлением любой комбинации операционных систем PC-DOS, MS-DOS, UNIX и XENIX;
совместимость снизу-вверх по архитектуре с МП 8086, 186, 286.
Основные технические характеристики.
Разрядность обрабатываемых данных – 1; 8; 16; 32 бит.
Максимальный объем прямо адресуемой памяти – 4 Гбайт (232).
Максимальный объем виртуальной памяти – 64 Тбайт (246).
Производительность – 34 млн. команд/с (средняя) при 16 МГц.
Тактовая частота – 16 МГц; 25 МГц; 33 МГц
Максимальный размер сегмента – 4 Гбайт.
Размер страницы – 4 Кбайт.
Количество уровней привилегированности – 4.
Количество выводов корпуса – 132.
Степень интеграции – 275 тыс. транзист.
Технология – CHMOS III (1,5мкм).
Размер кристалла – 9,75*10,4 мм.
2.1 АРХИТЕКТУРА 32-х РАЗРЯДНЫХ МИКРОПРОЦЕССОРОВ 386+
Базовая архитектура 32-х разрядных процессоров (обозначаемых: 386+) является общей для процессоров фирмы INTEL – 386, 486, PENTIUM и его модификаций.
МП состоит из 3 основных частей: устройства обработки;
устройства управления ЗУ;
интерфейсного блока.
УСТРОЙСТВО ОБРАБОТКИ состоит из исполнительного устройства (операционной части) и блока команд (управляющей части). Содержит 8 32-х разрядных РОН, 64-х битовый циклический сдвигатель. Умножение и деление осуществляется на 1 бит за цикл. Алгоритм умножения такой, что процесс прекращается, когда наиболее значащий бит, умножается на все нули. Типичное время умножения 32-х разрядных чисел около 1 мкс (для процессора I80386).
УСТРОЙСТВО УПРАВЛЕНИЯ ЗУ состоит из сегментного и страничного блоков. Сегментный блок позволяет работать с логическими адресами со всеми вытекающими отсюда преимуществами. Страничная организация используется внутри сегмента и управляет физическими адресами. Каждая задача может иметь до 16381 (214) сегмента до 4 Гбайт каждый (232), т.е. виртуальная память может быть размером 64 Тбайт (246).
ИНТЕРФЕЙСНЫЙ БЛОК обеспечивает взаимодействие с внешними устройствами, включая автоматическое управление разрядностью шины, и формирование сигналов активности байтов.
МП 386+ могут функционировать в трех режимах:
REAL ADDRESS MODE – режим реальной адресации (РРА) – характеризуется тем, что МП работает как очень быстрый 8086 с 32-битовым расширением; в этом режиме возможна адресация 1 Мбайта физической памяти (на самом деле, как у I80286, – почти на 64 Кбайта больше);
PROTECTED ADDRESS MODE – режим защищенной виртуальной адресации (РВА) – реализует все достоинства МП (режим параллельного выполнения нескольких задач несколькими 8086 – по одному на задачу). На одном процессоре в таком режиме могут одновременно исполняться несколько задач с изолированными друг от друга реальными ресурсами. При этом использование физического адресного пространства памяти управляется механизмами сегментации и трансляции страниц. Попытки выполнения недопустимых команд, выхода за рамки отведенного пространства памяти и разрешенной области ввода-вывода контролируются системой защиты.
VIRTUAL 8086 MODE – режим виртуального процессора 8086 (сокращенно – V86). Прикладная программа, которая выполняется в этом режиме, полагает, что она работает на процессоре 8086. Однако, некоторые команды, в основном связанные с управлением вводом-выводом, программе выполнять запрещается, поэтому при нарушении защиты генерируется прерывание и управление передается операционной системе.
В архитектуру процессора введены средства отладки и тестирования.