29. Общая шина. Цикл чтения.
30. Общая шина. Цикл записи.
Процессор осуществляет чтение слова из оперативной памяти в течение четырех тактов CLK (тактовых импульсов), или двух внутренних состояний процессора (т.е. каждое состояние процессора длится 2 такта синхросигнала CLK). Во время первого состояния, обозначаемого как Ts, процессор выставляет на адресную шину значение адреса, по которому будет читаться слово. Кроме того, он формирует на шине совместно с шинным контроллером соответствующие значения управляющих сигналов. Эти сигналы и адрес обрабатываются схемой управления памятью, в результате чего, начиная с середины второго состояния процессора Ts (т.е. в начале четвертого такта CLK) на шине данных появляется значение содержимого соответствующего слова из оперативной памяти. И, наконец, процессор считывает значение этого слова с шины данных. На этом перенос (копирование) значения слова из памяти в процессор заканчивается.
31. Общая шина. Цикл прерывания.
Концепция "Общей шины" предполагает, что обращения ко всем устройствам МПС производится в едином адресном пространстве, однако, в целях расширения числа адресуемых объектов, в некоторых системах искусственно разделяют адресные пространства памяти и ВУ (внешн. устр.), а иногда даже и памяти программ и памяти данных.
Прерывание - при поступлении сигнала прерывания процессор обязан прекратить выполнение текущей программы и немедленно начать обработку процедуры прерывания.
Подсистема прерываний - совокупность аппаратных и программных средств, обеспечивающих реакцию программы на события, происходящие вне программы. Такие события возникают, как правило, случайно и асинхронно по отношению к программе и требуют прекращения (чаще временного) выполнения текущей программы и переход на выполнение другой программы (подпрограммы), соответствующей возникшему событию.
Подсистема прерываний должна обеспечивать выполнение следующих функций: - обнаружение изменения состояния внешней среды (запрос на прерывание); - идентификация источника прерывания; - разрешение конфликтной ситуации в случае одновременного возникновения нескольких запросов (приоритет запросов);
- определение возможности прерывания текущей программы (приоритет программ); - фиксация состояния прерываемой (текущей) программы; - переход к программе, соответствующей обслуживаемому прерыванию;
- возврат к прерванной программе после окончания работы прерывающей программы.
32. Основные характеристики pci.
Высокоскоростной интерфейс: 32-64 разрядный с мультеплексированной ША данных.
Назначение: Универсальный интерфейс (соединение процессора с переферийными элементами и системой процессора памяти). Имеется встроенная поддержка кэширования (механизм слежения за шиной – интерференция данных). Скорость: 33,66,133 МГц. Пересылки: 32 и 64 бит, следовательно ширина ШД: 4-8 байт. Групповые пересылки разрешаются (Burst) . Реализован скрытый арбитраж: арбитраж осуществляется в то время когда на шину идут пересылки (время не тратится). Низкая стоимость, определяется малым числом выводов (49 для ”мастер” и 47 для Slave). Простота использования: реализована функция авто конфигурирования системы. Высокая надёжность: при пересылки осуществляется контроль чёткости адреса данных.